이 기술을 요구하는 공고가 함께 요구하는 것
- SoC·IP 설계 32건 중 26건 겹침
- RTL·Verilog 32건 중 23건 겹침
- 고속 인터페이스 32건 중 15건 겹침
- FPGA 32건 중 14건 겹침
- Python 32건 중 14건 겹침
- 회로설계·PCB 32건 중 12건 겹침
이 기술이 걸리는 분야
반도체31전기전자1자동차부품1
진행중인 채용
엑시나 상시
SoC 고속 인터페이스 설계 엔지니어 (SoC High Speed I/O Design Engineer)
경기 성남 경력
CXL 기반 메모리 SoC의 PCIe·DDR 등 외부 인터페이스 IP를 configuration·integration하고 검증할 설계 엔지니어
상시 접수 · 마감일 미정
퀄리타스반도체 상시
Analog Circuit Design Engineer(신입)
신입
MIPI·PCIe·HDMI 등 Interconnect IP와 SERDES 구성 회로를 설계할 아날로그 회로설계 신입 (석·박사)
상시 접수 · 마감일 미정
엑시나 상시
HW 보드 개발
경기 성남 경력
SoC의 SI/PI·Thermal을 고려한 보드 설계·검증과 SoC IP·Top Level 디자인 검증, 두 부문을 동시에 뽑습니다
상시 접수 · 마감일 미정
망고부스트코리아 상시
FPGA Platform Development Engineer (Seoul, South Korea)
서울 경력
FPGA IP integration과 synthesis·timing closure를 주도하고 ASIC 검증용 FPGA 프로토타입을 개발할 경력 5년 이상
상시 접수 · 마감일 미정
에이스웍스코리아 상시
임베디드 HW 개발자 (신입/경력)
서울 신입/경력
MCU/MPU 기반 타겟 보드의 회로를 설계하고 통신 중계·인터페이스 변환 보드를 개발할 임베디드 하드웨어 엔지니어
상시 접수 · 마감일 미정
딥엑스 상시
[Business] Japan Business Development Manager
경력
일본 산업용 비전·로보틱스 고객의 PoC를 design-in과 양산 매출로 전환할 사업개발 담당자 (7~12년 권장, 최소 8년)
상시 접수 · 마감일 미정
딥엑스 상시
[HW] Mixed-Signal IP Design Engineer
경력
초저전력 full-custom 회로와 datapath를 설계하고 양산 지원·실리콘 평가까지 맡을 mixed-signal IP 설계 엔지니어
상시 접수 · 마감일 미정
딥엑스 상시
[HW] SoC Bus Verification Engineer
경력
SoC Interconnect·Bus를 UVM/SystemVerilog로 검증하고 AMBA 프로토콜 준수와 성능을 확인할 검증 엔지니어
상시 접수 · 마감일 미정
아날로그AI 상시
[AnalogAI] Full Custom Layout Engineer
경력
Analog IP의 ADC/DAC·PLL·LDO 등 Full Custom 레이아웃과 검증을 담당할 Layout Engineer (3년 이상)
상시 접수 · 마감일 미정
딥엑스 상시
[HW] GPU Subsystem Engineer
경력
GPU IP를 NPU 중심 AI 추론 SoC에 통합하고 AMBA·NoC 데이터 경로를 최적화할 엔지니어 (경력 5년 이상)
상시 접수 · 마감일 미정
딥엑스 상시
[HW] CPU Subsystem Engineer
경력
ARM·RISC-V CPU IP를 NPU 중심 AI SoC에 통합하고 AMBA 기반 인터커넥트를 설계할 엔지니어 (경력 5년 이상)
상시 접수 · 마감일 미정
딥엑스 상시
[HW] High-Speed Interface SI/PI Engineer
경력
AI 반도체의 고속 인터페이스 Signal Integrity와 전원 네트워크를 해석·최적화할 엔지니어 (5년 이상)
상시 접수 · 마감일 미정
아날로그AI 상시
[AnalogAI](경력5년) Top Integration Circuit Design Engineer
경기 성남 경력
온디바이스 AI 반도체의 Top-Level RTL 통합과 클럭·파워 도메인, STA 타이밍 클로저를 맡을 설계 엔지니어 (5년 이상)
상시 접수 · 마감일 미정
아날로그AI 상시
[AnalogAI] Analog Circuit Design Engineer
경기 성남 경력
아날로그 인메모리 컴퓨팅(ACiM) AI 가속기의 혼성신호 인터페이스와 ADC/DAC를 설계할 회로 엔지니어 (신입~시니어)
상시 접수 · 마감일 미정
리벨리온 상시
Physical Design Engineer - Backend
경력
RTL to GDS 물리 구현으로 최적 PPA를 달성하고 IR-drop·EM 등 위반을 해결할 Physical Design 엔지니어 (EDA 툴 경험 8년 이상)
상시 접수 · 마감일 미정
디노티시아 상시
[SoC] SoC PKG / Board HW Engineer
경력
PCIe·DDR 등 high-speed 인터페이스를 SoC PKG와 Board에 구현·검증하고 양산 제품까지 개발할 HW 엔지니어 (경력 7년 이상)
상시 접수 · 마감일 미정
리벨리온 상시
Package PI/SI Engineer
경력
HBM3E·PCIe Gen6 등 고속 인터페이스의 전원·신호 완결성을 시뮬레이션으로 확보할 패키지 PI/SI 엔지니어 (경력 5년 이상)
상시 접수 · 마감일 미정
리벨리온 상시
Physical Design Engineer - Frontend
경력
RTL to GDS physical design으로 최적 PPA를 구현하고 STA·timing sign-off를 담당할 엔지니어 (경력 8년 이상)
상시 접수 · 마감일 미정
리벨리온 상시
Physical Implementation Engineer - DFT
경력
반도체 SoC의 Scan·BIST 삽입과 패키지 레벨 테스트 계획을 맡아 fault coverage를 높일 DFT 엔지니어 (EDA 경력 8년 이상)
상시 접수 · 마감일 미정
리벨리온 상시
SoC/Top Design Engineer
경력
복잡한 SoC의 top-level 아키텍처 설계와 RTL 통합, tape-out까지 맡을 설계 엔지니어 (RTL·SoC 5년 이상)
상시 접수 · 마감일 미정
디노티시아 상시
[SoC] SoC / RTL Design Engineer
경력
벡터 데이터 가속기 양산 칩의 RTL 블록을 Verilog로 설계하고 IP 통합·검증을 주도할 엔지니어 (5년 이상)
상시 접수 · 마감일 미정
하이퍼엑셀 상시
HW System Engineer(경력)
서울 경력
반도체 칩 평가·테스트용 PCB와 고속 인터페이스·고전력 보드를 설계할 HW 시스템 엔지니어 (PCB 설계 경력 10년 미만)
상시 접수 · 마감일 미정
아날로그AI 상시
[AnalogAI] (경력 5년) Senior Circuit Design Engineer
경기 성남 경력
온디바이스 AI 반도체의 FPGA·PCB 설계와 아날로그/혼성신호 회로, 커스텀 아날로그 IP를 개발할 회로설계 경력 5년 이상
상시 접수 · 마감일 미정
아날로그AI 상시
[AnalogAI] Junior Circuit Design Engineer (ADP Program)
경기 성남 무관
온디바이스 AI 반도체의 아날로그·혼성신호 회로와 FPGA·PCB를 설계할 주니어 회로 설계자 (경력 무관)
상시 접수 · 마감일 미정
망고부스트코리아 상시
IP Design Engineer (Seoul, South Korea)
서울 경력
ASIC·FPGA용 DPU IP를 Verilog로 설계하거나 IP 설계·QA 플로우를 자동화할 엔지니어 (경력 3년 이상)
상시 접수 · 마감일 미정
딥엑스 상시
[HW] SoC Physical Design Engineer
경력
NPU 칩의 RTL-to-GDSII 물리 설계와 PPA 최적화를 담당할 엔지니어 (ASIC 물리 설계 10년 이상)
상시 접수 · 마감일 미정
딥엑스 상시
[SW] PCIe Engineer
경력
PCIe subsystem 컨트롤러 펌웨어와 Linux 커널 드라이버를 pre/post silicon 환경에서 개발할 임베디드 SW 경력자
상시 접수 · 마감일 미정
파두 상시
SoC RTL Engineer
경력
SSD 컨트롤러 SoC의 RTL을 개발할 엔지니어 — SOC Platform, SSD/NAND IP, DDR, PCIe 중 1~2개 업무를 맡습니다
상시 접수 · 마감일 미정
딥엑스 상시
[HW] RTL Design Engineer (HW IP)
경력
AI 하드웨어 프로세서 개발을 중심으로 하드웨어 IP를 Verilog RTL로 설계·검증할 RTL 설계 엔지니어 (경력)
상시 접수 · 마감일 미정
딥엑스 상시
[HW] SoC ASIC Design Engineer
경력
AI 하드웨어 프로세서를 겨냥해 Verilog/SystemVerilog RTL과 SoC top-level 통합·검증을 담당할 설계 엔지니어
상시 접수 · 마감일 미정
엑시나 상시
SoC ASIC Design Engineer
경기 성남 경력
CXL 기반 메모리 디바이스의 ASIC Top을 integration하고 합성·검증할 SoC 설계 엔지니어
상시 접수 · 마감일 미정
엑시나 상시
SoC FPGA Design Engineer
경기 성남 경력
SoC 프로토타이핑용 FPGA 보드를 설계·검증하고 주요 IP를 FPGA Top Level에서 integration할 FPGA 설계 엔지니어
상시 접수 · 마감일 미정
이 기술을 뽑는 기업
- 딥엑스
- 리벨리온
- 아날로그AI
- 엑시나
- 디노티시아
- 망고부스트코리아
- 에이스웍스코리아
- 퀄리타스반도체
- 파두
- 하이퍼엑셀